數字電路試題及答案

　　用數字信號完成對數字量進(jìn)行算術(shù)運算和邏輯運算的電路稱(chēng)為數字電路，或數字系統。下面就是小編整理的數字電路試題及答案，一起來(lái)看一下吧。

　　數字電子技術(shù)基礎試題及答案

　　一、單項選擇題(每小題1分，共10分)

　　1、以下描述一個(gè)邏輯函數的方法中，( )只能唯一表示。

　　A.表達式 nbsp;B.邏輯圖 nbsp;C.真值表 D.波形圖

　　2、在不影響邏輯功能的情況下，CMOS與非門(mén)的多余輸入端可( )。

　　A.接高電平 B.接低電平 nbsp;C.懸空 nbsp;D.通過(guò)電阻接地

　　3、一個(gè)八位二進(jìn)制減法計數器，初始狀態(tài)為00000000，問(wèn)經(jīng)過(guò)268個(gè)輸入脈沖后，此計數器的狀態(tài)為( )。

　　A.11001111 B.11110100 C.11110010 D.11110011

　　4、若要將一異或非門(mén)當作反相器(非門(mén))使用，則輸入端A、B端的連接方式是( )。

　　A.A或B中有一個(gè)接“1” B.A或B中有一個(gè)接“0”

　　C.A和B并聯(lián)使用 nbsp;D.不能實(shí)現

　　5、在時(shí)序電路的狀態(tài)轉換表中，若狀態(tài)數N=3，則狀態(tài)變量數最少為( nbsp;)。

　　A.16 B.4 C.8 D.2

　　6、下列幾種TTL電路中，輸出端可實(shí)現線(xiàn)與功能的門(mén)電路是( )。

　　A.或非門(mén) B.與非門(mén) C.異或門(mén) D.OC門(mén)

　　7、下列幾種A/D轉換器中，轉換速度最快的是( )。

　　A.并行A/D轉換器 nbsp;B.計數型A/D轉換器

　　C.逐次漸進(jìn)型A/D轉換器 D.雙積分A/D轉換器

　　8、存儲容量為8K×8位的ROM存儲器，其地址線(xiàn)為( )條。

　　A.8 B.12 C.13 D.14

　　9、4個(gè)觸發(fā)器構成的8421BCD碼計數器，共有( )個(gè)無(wú)效狀態(tài)。

　　A.6 B.8 C.10 D.12

　　10、以下哪一條不是消除竟爭冒險的措施( )。

　　A.接入濾波電路 B.利用觸發(fā)器

　　C.加入選通脈沖 D.修改邏輯設計

　　二、填空題(每空1分，共20分)

　　1、時(shí)序邏輯電路一般由（ ）和( )兩分組成。

　　2、多諧振蕩器是一種波形產(chǎn)生電路，它沒(méi)有穩態(tài)，只有兩個(gè)

　　3、數字電路中的三極管一般工作于________區和________區。

　　4、四個(gè)邏輯變量的最小項最多有________個(gè)，任意兩個(gè)最小項之積為_(kāi)_______。

　　5、555定時(shí)器是一種用途很廣泛的電路，除了能組成________觸發(fā)器、________觸發(fā)

　　器和________三個(gè)基本單元電路以外，還可以接成各種實(shí)用電路。

　　6、用2048×12的ROM芯片，最多能實(shí)現________個(gè)輸入________個(gè)輸出的組合邏輯

　　函數。

　　7、對于JK觸發(fā)器，若J=K，則可完成________觸發(fā)器的邏輯功能;若K=J=1，則完成

　　________觸發(fā)器的邏輯功能。

　　8、時(shí)序邏輯電路的輸出不僅和_________有關(guān)，而且還與________有關(guān)。

　　9、三態(tài)門(mén)的輸出狀態(tài)有________、低電平、________三種狀態(tài)。

　　10、采用ISP技術(shù)的PLD是先裝配，后________。

　　11、轉換速度|和______________是衡量A/D轉換器和D/A轉換器性能優(yōu)劣的主要指標。

　　三、簡(jiǎn)答題(每小題5分，共15分)

　　1、證明邏輯函數式： BC D D(B C )(AD B) B D。

　　2、試述施密特觸發(fā)器和單穩態(tài)觸發(fā)器的工作特點(diǎn)。

　　四、分析設計題(共30分)

　　1、試列寫(xiě)下列 ROM結構中Y2、Y1、Y0的函數表達式，并采用八選一數據選擇器 74LS152對Y2、Y1、Y0重新實(shí)現。要求寫(xiě)出實(shí)現表達式，并畫(huà)出邏輯電路圖。其中，ROM地址譯碼器中，輸入地址選中的列線(xiàn)為高電平。(10分)

　　2、試用 JK觸發(fā)器和門(mén)電路設計一個(gè)十三進(jìn)制的計數器，要求體現邏輯抽象、狀態(tài)化簡(jiǎn)、狀態(tài)方程、特性方程、驅動(dòng)方程和輸出方程等中間過(guò)程，畫(huà)出邏輯電路圖，并檢查所設計的電路能否自啟動(dòng)。(20分)

　　參考答案

　　一、單項選擇題。

　　1-5 nbsp;CABBD

　　6-10 DACAB

　　二、填空題。

　　1、存儲電路，組合電路

　　2、暫穩態(tài)

　　3、截止，飽和

　　4、16，0

　　5、施密特，單穩態(tài)，多諧振蕩器

　　6、11，12

　　7、T，T′

　　8、該時(shí)刻輸入變量的取值，電路原來(lái)的狀態(tài)

　　9、高電平，高阻態(tài)

　　10、編程

　　11、轉換精度

　　三、簡(jiǎn)答題

　　1、證明：左邊= BC D (B C )(AD B) BC D BAD CAD CB

　　2、解：邏輯函數表達式：Y AB BC AC

　　真值表：

　　A B C

　　0 0 0

　　0 0 1

　　0 1 0

　　0 1 1

　　1 0 0

　　1 0 1

　　1 1 0

　　1 1 1

　　Y

　　1

　　1

　　1

　　1

　　該電路為三人表決電路，只要有 2票或 3票同意，表決就通過(guò)。

　　3、解：

　　施密特觸發(fā)器：(1)輸入信號從低電平上升的過(guò)程中，電路狀態(tài)轉換時(shí)對應的輸入電平，與輸入信號從高電平下降過(guò)程中對應的輸入轉換電平不同;(2)在電路狀態(tài)轉換時(shí)，通過(guò)電路內部的正反饋過(guò)程使輸出電壓波形的邊沿變得很陡。

　　單穩態(tài)觸發(fā)器：(1)有穩態(tài)、暫穩態(tài)兩個(gè)狀態(tài);(2)在外界觸發(fā)脈沖作用下，能從穩態(tài)翻轉到暫穩態(tài)，暫穩態(tài)持續一段時(shí)間后，自動(dòng)回到穩態(tài);(3)暫穩態(tài)持續時(shí)間的長(cháng)短取決于電路本身參數，與觸發(fā)脈沖的寬度和幅度無(wú)關(guān)。

　　四、分析設計題

　　1、略

　　2、略

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